FPGA

在使用过VCS配合Verdi进行波形仿真之后，再也无法忍受vivado那缓慢的仿真与卡顿的界面，Verdi追踪信号更是极快加速问题定位。不过FPGA的IP不能像普通Verilog IP一样直接使用VCS进行编译仿真，需要调用一些Vivado...

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FPGA autumn recruit study notes (3): Verilog syntax and basic design
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FPGA autumn recruitment study notes (2): FPGA hardware composition and logic circuit
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在tcl命令窗口输入，123为保存的文件名，需要带路径 read_hw_ila_data 123.ila display_hw_ila_data ...